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FPGA 電源系統管理

本文作者:Pinkesh Sachdev       點擊: 2020-11-13 15:52
前言:

簡介現場可編程閘陣列 (FPGA) 的起源可以追溯至20 世紀 80 年代,其為從可編程邏輯元件 (PLD) 演變而來。自此之後,FPGA 資源、速度和效率都獲得了快速的改善,使 FPGA 成為廣泛的運算和處理應用的首選解決方案,特別是當產量不足以證明專用積體電路 (ASIC) 的開發成本合理有效時。FPGA取得快速發展,並廣泛用於大規模部署。例如,繼2013 年試點項目中使用 FPGA 成功加快 Bing 搜尋引擎的速度之後,Microsoft 將配備 FPGA 的伺服器使用範圍擴展到雲端資料中心。

FPGA 電源系統要求FPGA 需要幾個不同的低壓供電軌,每個供電軌都有自己的電壓和電流規格,以便為其核心邏輯、I/O 電路、輔助邏輯、收發器和記憶體供電。這些供電軌可能需要按特定的順序開啟和關閉,以避免損壞 FPGA。負載點 (POL) 穩壓器將電路板較高的輸入電源電壓降低為 FPGA 所需的多個輸入電壓。當功率轉換效率至關重要時,開關穩壓器可用作 POL穩壓器,而線性穩壓器 ( 例如低壓差 (LDO) 穩壓器 )則用於雜訊敏感型電路,例如 PLL 和收發器。

圖 :一種可行的 FPGA 電源樹設計:高壓輸入電源 ( 例如 12 V、24 V 或 48 V) 降至中間匯流排電壓,之後饋送給為 FPGA 供電的 POL 穩壓器。

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