2013年7月2日--致力於提供幫助功率管理、安全、可靠與高性能半導體技術產品的領先供應商美高森美公司(Microsemi) 宣佈SmartFusion®2 SoC FPGA用戶現在可以享受到其日前發表的系統創建器(System Builder)設計工具所帶來的各種效益。System Builder是Libero System-on-Chip (SoC)設計環境11.0版本中的一款功能強大之全新設計工具，目的是為了加快使用SmartFusion2 SoC FPGA的ARM®系統的客戶定義和設計實施。
美高森美公司的軟體及系統工程副總裁Jim Davis表示：“System Builder可大幅簡化美高森美公司SmartFusion2 SoC FPGA在嵌入式系統應用中的設計流程。由於器件已變得愈來愈複雜，這些設計在架構規範的階段就愈來愈容易出錯。藉由System Builder之助，設計工程師可以經由一高階且逐步指引的流程，很快且輕易地定義出所要的系統架構。”
System Builder的輸出是自動生成的，並具有構造自糾正特性(correct-by-construction)，從而消除了在較傳統工具流程中“通過手工”定義架構時所產生的錯誤。因此，System Builder可以大幅縮短複雜SoC FPGA的設計週期時間。
此外偏向軟體設計的工程師可以輕易創建一個嵌入式架構，然後開始開發自己的代碼。這樣便可簡化採用美高森美 SmartFusion2器件的流程，並且還可讓更多的設計工程師使用到SoC FPGA技術。增強的System Builder流程還可讓美高森美通過其內部設計服務團隊來支援更多的客戶，該團隊可為最終客戶提供用於客製化功能模組的數位或混合訊號設計、軟IP、韌體開發，甚至完整的設計。
System Builder用戶藉由逐步的指引，完成各主要SoC FPGA架構模組的設計。此一設計流程採用高階的圖形介面，它會對先前的架構選擇作出反應，並且帶領使用者完成選擇的流程和配置所需的嵌入式系統模組，自動生成最終的系統規範，並且具有構造正確性。這個規範包括ARM處理器及其相關週邊設備，以及在FPGA結構中實施的其它IP模組之配置和互連。System Builder也可配置愈來愈多且用於高性能介面的IP模組組合，包括DDR2/DDR3/LPDDR記憶體控制器，以及使用5Gbps SERDES用於PCIe、XAUI (10 GbE) 和SGMII的序列介面。System Builder內提供的其它建基於結構的參數化IP功能包括I2C、SPI、計時器、UART和PWM模組。這些大量且經過驗證的IP功能可以快速且輕易地用來開發特定應用的SoC，從而縮短全系列工業、通訊、航空和國防系統的上市時間。
